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在瑞日，每个员工以阳光的心态积极愉快地工作和生活。我们不仅为员工营造轻松向上的工作氛围、提供整洁舒适的办公环境，更为刚步入社会的新人们提供更为清晰、通畅、快速的职业发展通道。
薪酬福利
♦ 公司缴纳社保五险一金、带薪年假、节日福利、集体聚餐、年度旅游、年底13薪、年终奖金
岗位职责：
1、使用Verilog/VHDL编写逻辑模块的RTL级代码；
2、编写测试向量对模块进行仿真验证；
3、编写完整的设计和验证报告。
4、可独立完成板级调试的工作
任职要求：
1、通信、电子、计算机等专业本科以上学历；
2、具有良好的数字电路，通信原理，逻辑设计专业基础理论知识；
3、两年以上FPGA设计经验，熟悉Xilinx，Altera等厂商器件及设计流程，熟练掌握ISE/Quatus II等设计工具；
4、熟练掌握VHDL或Verilog语言，会使用常用的开发工具、仿真工具和常用测试仪器；
5、较强的电路分析、调试能力，可独立完成代码编写和板级调试的工作。
岗位职责：
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